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CIRCUITOS DIGITALES

eman ta zabal zazu. Universidad del País Vasco Departamento de Arquitectura y Tecnología de Computadores. upv. ehu. CIRCUITOS DIGITALES. Definiciones Escalas de integración Familias lógicas. Definiciones. Señal digital: señal discreta que sólo puede tomar ciertos valores

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  1. eman ta zabal zazu Universidad del País Vasco Departamento de Arquitectura y Tecnología de Computadores upv ehu CIRCUITOS DIGITALES • Definiciones • Escalas de integración • Familias lógicas

  2. Definiciones • Señal digital: señal discreta que sólo puede tomar ciertos valores • Señal digital binaria: sólo dos valores, VH y VL • Circuitos que vamos a ver: VH = 5 V , VL = 0 V • Correspondencia: valor físico  valor lógico

  3. Definiciones • Circuito digital: procesa señales digitales • Puertas lógicas: tensión salida función de la/s tensión/es de entrada • Necesita estar alimentada. • Tabla de verdad: expresa relación tensión entrada y salida • Intervalos de las tensiones: criterio de proximidad

  4. Escalas de integración • Circuito integrado: distintos componentes integrados en un trozo de silicio • Escala de integración: nº aproximado de componentes dentro del chip • SSI (10), MSI (100), LS (miles), VLSI (millones)

  5. Familias lógicas • Distintos componentes, distintas familias • DL, Diode Logic • apenas se utiliza AND • DTL, Diode Transistor Logic NAND

  6. Familias lógicas • RTL, Resistor Transistor Logic NOT • TTL, Transistor Transistor Logic • Transistor multiemisor • Rápidos • Consumo potencia alto NAND

  7. Familias lógicas • NMOS • Menor potencia NOT • CMOS: transistores NMOS y PMOS • Más lentas que TTL • Más pequeñas • Consumo potencia bajo NOT

  8. V S V E V S V E Transistores bipolares en las puertas lógicas • Dos tensiones: H, L. Dos zonas de funcionamiento: corte y saturación • Esquema ideal CORTE VBE 0,7 SATURACIÓN +5V S + E + – – +5V S + E 0.5 + 0.7 – –

  9. D N G N V S V S N E D N G N V S V S N E Transistores NMOS en las puertas lógicas • Dos tensiones: H, L. Dos zonas de funcionamiento: corte y zona óhmica • Esquema ideal, VT >0 CORTE VGS  VT ZONA ÓHMICA VGS  VT +5 V S + E + – – +5 V S + E + – –

  10. D G V S V S E D G V S V S E Transistores PMOS en las puertas lógicas • Dos tensiones: H, L. Dos zonas de funcionamiento: corte y zona óhmica • Esquema ideal, VT < 0 CORTE VGS  VT ZONA ÓHMICA VGS  VT +5 V S + E + – – +5 V + S + E – –

  11. S P G P D P D N G N V S S V N E S P G P D P D N G N V S S V N E Lógica CMOS +5 V S + E VE= 5V + – – +5 V VE= 0V S + E + – –

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